信号列表
信号名
I/O
位宽
clk
rst_n
28
128
128
32
【FPGA 20个例程篇：10.遍历DDR3内存颗粒读写循环校验】表1 模块信号列表

文章插图
图2 DDR3驱动模块的代码设计
如图3所示是遍历DDR3内存颗粒读写循环校验顶层文件的例化，这里只需要把按键模块，串口发送模块以及DDR3驱动模块的相关信号例化到一起即可 。
图3 遍历DDR3内存颗粒读写循环校验顶层文件的例化
如图4所示，当按下豌豆开发板按键后，即可触发FPGA进行一次DDR内存颗粒读写循环校验，短暂地间隔1-2秒钟遍历校验完成后，串口助手打印即可打印出错误统计计数器的值，朋友们可以看到遍历校验完成后，DDR3颗粒每个突发地址都读写正常 。
图4 串口助手打印DDR内存颗粒读写循环校验后错误统计计数器的值

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